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一、考試內容
1、概述
數字系統模型、數字系統結構、數字系統設計方法
2、數字系統算法描述
算法流程圖、算法狀態機圖(ASM圖)
3.數字系統的硬件描述語言
VHDL或Verilog HDL的結構與要素，基本語法、組合邏輯、時序邏輯、有限狀態機設計，以及其它功能模塊如乘法器、DDS信號發生器等設計。
二、考試題型
概念題、分析論述題、設計題、作圖題
三、考試形式
筆試、閉卷，考試時間為180分鐘，試卷滿分為100分。
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